{"id":13154,"date":"2024-02-20T15:52:35","date_gmt":"2024-02-20T15:52:35","guid":{"rendered":"https:\/\/introspect.ca\/2024\/02\/20\/introspect-technology-introduces-lpddr5-lpddr5x-protocol-analyzer\/"},"modified":"2026-07-10T19:57:00","modified_gmt":"2026-07-10T19:57:00","slug":"introspect-technology-introduces-lpddr5-lpddr5x-protocol-analyzer","status":"publish","type":"post","link":"https:\/\/introspect.ca\/fr\/2024\/02\/20\/introspect-technology-introduces-lpddr5-lpddr5x-protocol-analyzer\/","title":{"rendered":"Introspect Technology pr\u00e9sente un analyseur de protocole LPDDR5\/LPDDR5X"},"content":{"rendered":"

Cet article a \u00e9t\u00e9 initialement publi\u00e9 par All About Circuits<\/a>. Vous pouvez consulter l’article original ici.<\/a> <\/p>\n

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16 F\u00c9VRIER 2024 PAR DUANE BENSON<\/a><\/p>\n

Introspect Technology pr\u00e9sente un analyseur de protocole LPDDR5\/LPDDR5X<\/h2>\n

La conception de l’interposeur \u00ab package-on-package \u00bb de l’analyseur permet d’utiliser des c\u00e2bles plus courts et d’effectuer des mesures par sondage actif \u00e0 une vitesse de 8 533 MT\/s ou plus.<\/h3>\n

La m\u00e9moire LPDDR5 (Low-power Double Data Rate 5) est aujourd\u2019hui l\u2019option de m\u00e9moire la plus performante pour les appareils mobiles. Elle offre la m\u00eame vitesse \u00e9lev\u00e9e que la DDR5 classique, mais sacrifie la densit\u00e9, l\u2019\u00e9volutivit\u00e9 et la topologie \u00e0 double canal de la DDR5 au profit de caract\u00e9ristiques avantageuses pour les appareils mobiles, telles qu\u2019une consommation d\u2019\u00e9nergie r\u00e9duite. La derni\u00e8re version de cette norme, la LPDDR5X, pr\u00e9sent\u00e9e par le JEDEC en juin 2021, offre une vitesse accrue et une consommation d’\u00e9nergie encore plus faible que la LPDDR5 standard. <\/p>\n

Introspect Technology a r\u00e9cemment lanc\u00e9 l’analyseur de protocole SV7M-LPDDR5PA<\/a>, destin\u00e9 \u00e0 permettre la v\u00e9rification de la conformit\u00e9, l’analyse approfondie et le d\u00e9bogage au sein d’un syst\u00e8me LPDDR5 en fonctionnement.<\/p>\n

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Analyseur de protocole LPDDR5 SV7M-LPDDR5PA<\/figcaption><\/figure>\n

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Les contraintes li\u00e9es \u00e0 la m\u00e9moire LPDDR5 n\u00e9cessitent une solution d’acc\u00e8s innovante<\/h4>\n

Les gains de performances de la LPDDR5 ne se limitent pas \u00e0 la puce m\u00e9moire elle-m\u00eame, mais concernent \u00e9galement la conception physique du produit. Les versions actuelles de la LPDDR5 doivent \u00eatre plac\u00e9es aussi pr\u00e8s que possible du processeur et doivent \u00eatre soud\u00e9es. Dans un appareil mobile, la m\u00e9moire est souvent soud\u00e9e directement sur le processeur selon une configuration \u00ab package-on-package \u00bb (PoP). <\/p>\n

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Interposeur LPDDR5 pour le test en temps r\u00e9el du syst\u00e8me<\/figcaption><\/figure>\n

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Dans la technologie PoP, le processeur comporte des billes de soudure BGA sur sa face inf\u00e9rieure et des pastilles de soudure sur sa face sup\u00e9rieure destin\u00e9es \u00e0 accueillir la puce m\u00e9moire. Il est soud\u00e9 sur le circuit imprim\u00e9, et la puce m\u00e9moire, \u00e9galement de type BGA, est soud\u00e9e sur la face sup\u00e9rieure du processeur, ce qui donne lieu \u00e0 un empilement semblable \u00e0 un g\u00e2teau d\u2019anniversaire o\u00f9 les broches de la puce ne sont pas accessibles au-del\u00e0 des rang\u00e9es ext\u00e9rieures. Introspect r\u00e9sout ce probl\u00e8me gr\u00e2ce \u00e0 un circuit imprim\u00e9 interposeur. L\u2019interposeur est plac\u00e9 au-dessus du processeur et la puce m\u00e9moire LPDDR5 est dispos\u00e9e sur le dessus du circuit imprim\u00e9. <\/p>\n

Principales caract\u00e9ristiques et avantages<\/h4>\n

Le SV7M-LPDDR5PA prend en charge un canal complet, comprenant \u00e0 la fois le bus de commande et le bus de donn\u00e9es, pour les normes LPDDR5 et LPDDR5X, \u00e0 un d\u00e9bit pouvant atteindre 8 700 m\u00e9ga-transferts par seconde (MT\/s). Il prend en charge le d\u00e9codage et l’analyse des commandes pour les normes LPDDR4, LPDDR5, LPDDR5X et DDR5. <\/p>\n

La conception modulaire comprend des t\u00eates d’\u00e9chantillonnage \u00e0 distance (RHS) plac\u00e9es \u00e0 proximit\u00e9 du dispositif test\u00e9 afin de permettre une capture compl\u00e8te des donn\u00e9es et des commandes. Ces t\u00eates d’\u00e9chantillonnage RHS sont \u00e9quip\u00e9es de sondes actives d’une bande passante de 10 GHz sur l’ensemble des 32 canaux, ce qui permet d’effectuer des mesures \u00e0 large bande passante tout en r\u00e9duisant les pertes au niveau de l’interposeur. L\u2019analyseur propose \u00e9galement une capture num\u00e9rique d\u00e9clench\u00e9e en mode \u00ab one-shot \u00bb sur les bus de commande et de donn\u00e9es en parall\u00e8le, permettant une validation simultan\u00e9e des caract\u00e9ristiques \u00e9lectriques et du protocole \u00e0 l\u2019aide de la m\u00eame t\u00eate d\u2019\u00e9chantillonnage RSH et du m\u00eame interposeur. <\/p>\n

Parmi les autres caract\u00e9ristiques notables du SV7M-LPDDR5PA, on peut citer 32 r\u00e9cepteurs diff\u00e9rentiels ou asym\u00e9triques permettant de couvrir l’int\u00e9gralit\u00e9 d’un canal LPDDR5 (y compris le bus de commande et les 16 broches de donn\u00e9es), ainsi que 12 broches GPIO destin\u00e9es \u00e0 l’\u00e9talonnage automatique de toutes les unit\u00e9s RSH. L’analyseur peut se d\u00e9clencher sur n’importe laquelle des commandes ACT1, ACT2, CAS, DES, MPC, ainsi que sur toutes les commandes figurant dans la table de v\u00e9rit\u00e9 LPDDR5. <\/p>\n

Contr\u00f4les sur site<\/h4>\n

La m\u00e9moire DDR5 basse consommation est destin\u00e9e aux applications soumises \u00e0 des contraintes d\u2019espace et de consommation \u00e9lectrique, telles que les appareils mobiles et l\u2019informatique automobile. De ce fait, la plupart des impl\u00e9mentations ne sont ni \u00e9quip\u00e9es de connecteurs ni modulaires. De plus, les d\u00e9bits de la LPDDR5 exigent que les utilisateurs fassent preuve d\u2019une extr\u00eame prudence lors de l\u2019utilisation de cette technologie de m\u00e9moire afin d\u2019\u00e9viter de compromettre l\u2019int\u00e9grit\u00e9 du signal avec l\u2019\u00e9quipement de test. Ces conditions rendent l\u2019utilisation de syst\u00e8mes de sockets ou de c\u00e2bles interm\u00e9diaires peu pratique, voire impossible \u00e0 mettre en \u0153uvre. <\/p>\n

Le circuit imprim\u00e9 interposeur achemine directement toutes les broches de la puce, du processeur \u00e0 la m\u00e9moire, r\u00e9duisant ainsi les risques de d\u00e9gradation du signal. Le circuit imprim\u00e9 interposeur capte tous les signaux n\u00e9cessaires, qui sont termin\u00e9s par des r\u00e9sistances de pointe de sonde actives. La carte achemine ces signaux vers des connecteurs destin\u00e9s aux t\u00eates d\u2019\u00e9chantillonnage \u00e0 distance, permettant ainsi l\u2019acc\u00e8s aux donn\u00e9es et aux lignes de commande n\u00e9cessaires. Le syst\u00e8me se veut un outil d\u2019analyse de haute qualit\u00e9 qui tient compte \u00e0 la fois des exigences des composants et des contraintes de son environnement d\u2019exploitation. <\/p>\n

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Toutes les images sont utilis\u00e9es avec l’aimable autorisation d’Introspect Technology. <\/em><\/p>\n","protected":false},"excerpt":{"rendered":"

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